Allegro原理图和PCB设计流程学习指南

Allegro原理图和PCB设计流程学习指南

Allegro原理图和PCB设计流程学习指南 一、非电气引脚零件的制作

1、建圆形钻孔：

1）、parameter：没有电器属性（non-plated）

2）、layer：只需要设置顶层和底层的regular pad，中间层以及阻焊层和加焊层都是null。

注意：regular pad要比drill hole大一点。

二、Allegro建立电路板板框

步骤：

1、设置绘图区参数，包括单位，大小。

2、定义outline区域

3、定义route keepin区域（可使用Z-copy操作）

4、定义package keepin区域

5、添加定位孔

三、Allegro定义层叠结构

对于最简单的四层板，只需要添加电源层和底层，步骤如下：

1、Setup –> cross-section

2、添加层，电源层和地层都要设置为plane，同时还要在电气层之间加入电介质，一般为FR-4

3、指定电源层和地层都为负片（negtive）

4、设置完成可以再Visibility看到多出了两层：GND和POWER

5、铺铜（可以放到布局后再做）

6、z-copy –> find面板选shape（因为铺铜是shape） –> option面板的copy to class/subclass选择ETCH/GND（注意选择create dynamic shape）完成GND层覆铜

7、相同的方法完成POWER层覆铜

四、Allegro生成网表

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1、重新生成索引编号：tools –> annotate

2、DRC检查：tools –> Design Rules Check，查看session log。

3、生成网表：tools –> create netlist，产生的网表会保存到allegro文件夹，可以看一下session log内容。

五、Allegro导入网表

1、file –> import –> logic –> design entry CIS（这里有一些选项可以设置导入网表对当前设计的影响）

2、选择网表路径，在allegro文件夹。

3、点击Import Cadence导入网表。

4、导入网表后可以再place –> manully –> placement list选components by refdes查看导入的元件。

5、设置栅格点，所有的非电气层用一套，所有的电气层用一套。注意手动放置元件采用的是非电气栅格点。

6、设置drawing option，status选项会显示出没有摆放元件的数量，没有布线的网络数量

六、Allegro手工摆放元件

1、place –> manully –> components by refdes可以看到工程中的元件，可以利用selection filters进行筛选。另外也可以手工摆放库里的元件。还可以将对话框隐藏（hide），并且右键 –> show就可以显示了。

2、如何镜像摆放到底层？

方法一：先在option选mirror，在选器件

方法二：先选器件，然后右键 –> mirror

方法三：setup –> drawing option –> 选中mirror，就可进行全局设置 方法四：对于已摆放的零件，Edit –> mirror在find面板选中symbol，再选元件

这样放好元件后就会自动在底层。

3、如何进行旋转？

方法一：对于已经摆放的元件，Edit –> move 点击元件，然后右键 –> rotate就可以旋转

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方法二：摆放的时候进行旋转，在option面板选择rotate

七、Allegro快速摆放元件

1、开素摆放元件：place –> quickplace –> place all components

2、如何关闭和打开飞线？

关闭飞线：Display –> Blank Rats –> All 关闭所有飞线

打开飞线：Display –> Show Rats –> All 打开所有飞线

3、快速找器件：Find面板 –> Find By Name –> 输入名字

八、Allegro布局基本知识

1、摆放的方法：Edit –> move或mirror或rotate

2、关于电容滤波，当有大电容和小电容同时对一点滤波时，应该把从小电容拉出的线接到器件管脚。即靠近管脚的为最小的电容。

3、各层颜色设置：top –> 粉色；bottom –> 蓝色；

九、约束规则的设置概要

1、约束的设置：setup –> constrains –> set standard values 可以设置线宽，线间距。间距包括：pin to pin、line to pin、line to line等

2、主要用spacing rule set 和 physical rule set 来设置线距、线宽及过孔规则。

3、Spacing rule set 主要设置线距规则。

4、Physical rule set 主要设置线宽及过孔规则。

十、约束规则设置具体方法

1、在进行设置时，注意在Constrain Set Name选择Default。这样只要是没有特殊指定的网络，都是按照这个规则来的。

2、一般设置规则：pin to pin为6mil，其他为8mil。

3、Physical Rule中设置最大线宽，最小线宽，颈状线（neck），差分对设置（这里设置的优先级比较低，可以不管，等以后专门对差分对进行设置），T型连接的位置，指定过孔

4、添加一个线宽约束：先添加一个Constraint Set Name，在以具体网络相对应。

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十一、区域规则设置

1、设定特定区域的规则，例如，对于BGA器件的引脚处需要设置线宽要窄一些，线间距也要窄一些。

2、setup –> constraints –> constraint areas –> 选中arears require a TYPE property –> add 可以看到options面板的class/subclass为Board Geometry/Constraint_Area –> 在制定区域画一个矩形 –> 点击矩形框，调出edit property –> 指定间距（net spacing type）和线宽(net physical type) –> 在assignment table进行指定

十二、创建总线

1、打开约束管理器 Setup -> Electronical constraint spreadsheet）

2、显示指定网络飞线：Display –> show rats –> net 然后在约束管理器中选择要显示的网络

3、如果要设置等长线，但是在线上有端接电阻，那么需要进行设置（x net），使得计算的时候跨过端接电阻。这就需要为每一个端接电阻设置仿真模型库，设置完成以后，就可以在约束管理器中的看到网络变为了x net

4、添加信号仿真模型库：Analyze –> SI/EMI Sim –> Library 添加模型库 –> Add existing library –> local library path

5、对每个新建添加模型：Analyze –> SI/EMI Sim –> Model 会显示出工程中的器件，然后为每个器件添加仿真模型。对于系统库里面的元件有自己的模型库，可以利用Auto Setup自动完成。对于系统库里面没有的模型，选择find model

6、在约束管理器中，点击object –> 右键，即可利用filter选择需要选择的网络，可以选择差分对，x net等。

7、创建总线：在约束管理器中，选择net –> routing –> wiring 然后选择需要创建为总线的网络 –> 右键，create –> bus

十三、设置拓扑约束

十四、线长约束规则设置

1、对线长的要求，实际就是设置延时，可以按照长度来设置，也可以按照延时来设置

2、打开约束管理器 Setup –> Electronic constraint set –> All constraint –> User – defined 选择在设置拓扑结构时设置好的网络 –> 右键选择

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SigXplore –> 在 pro delay里选择。也就是说如果要想设置线长约束，需要先定义一个拓扑结构，然 …… 此处隐藏：8896字，全部文档内容请下载后查看。喜欢就下载吧 ……